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	當(dāng)前位置： 首頁(yè)出版圖書(shū)科學(xué)技術(shù)計(jì)算機(jī)/網(wǎng)絡(luò)網(wǎng)絡(luò)與數(shù)據(jù)通信網(wǎng)絡(luò)通信綜合集成數(shù)字系統(tǒng)EDA設(shè)計(jì)：硬件描述語(yǔ)言應(yīng)用實(shí)訓(xùn)

	



    
    

    
集成數(shù)字系統(tǒng)EDA設(shè)計(jì)：硬件描述語(yǔ)言應(yīng)用實(shí)訓(xùn)

    

	
集成數(shù)字系統(tǒng)EDA設(shè)計(jì)：硬件描述語(yǔ)言應(yīng)用實(shí)訓(xùn)
	
	

	

	

	
定　價(jià)：￥79.00

	

			
					

						作　者：
						武衛(wèi)華
					

					

						出版社：
						中國(guó)科學(xué)技術(shù)大學(xué)出版社
					

					

						叢編項(xiàng)：
						
					

					

						標(biāo)　簽：
						暫缺
					

				
	
	

    
	

	

			
					

						ISBN：
						9787312056253
						出版時(shí)間：
						2023-08-01	
                        包裝：
						平裝					
					
					
					
					
						開(kāi)本：
						16開(kāi)
						頁(yè)數(shù)：
						383
						字?jǐn)?shù)：
						 
					
					
				

        

   

    
    
    
	
	
	
	
內(nèi)容簡(jiǎn)介

	

	
　　本書(shū)是安徽省高等學(xué)校省級(jí)質(zhì)量工程項(xiàng)目“新工科背景下自動(dòng)化專(zhuān)業(yè)實(shí)踐教學(xué)體系改革研究”“電類(lèi)專(zhuān)業(yè)系列基礎(chǔ)課程思政教學(xué)團(tuán)隊(duì)”及安徽工業(yè)大學(xué)馬鞍山產(chǎn)業(yè)學(xué)院建設(shè)成果，也是安徽工業(yè)大學(xué)馬鞍山產(chǎn)業(yè)學(xué)院系列規(guī)劃教材之一。本書(shū)基于新工科教學(xué)理念，結(jié)合電類(lèi)專(zhuān)業(yè)人才培養(yǎng)目標(biāo)，系統(tǒng)介紹了集成數(shù)字系統(tǒng)的EDA設(shè)計(jì)方法、設(shè)計(jì)描述及設(shè)計(jì)開(kāi)發(fā)過(guò)程，旨在使學(xué)生掌握集成數(shù)字系統(tǒng)自頂向下的層次化、模塊化行為描述建模方法，具備應(yīng)用VHDL、Verilog語(yǔ)言進(jìn)行集成數(shù)字系統(tǒng)設(shè)計(jì)開(kāi)發(fā)的能力。本書(shū)側(cè)重于工程應(yīng)用實(shí)踐，詳細(xì)闡述了多個(gè)集成數(shù)字系統(tǒng)實(shí)訓(xùn)案例，可作為微電子、集成電路、電子信息、通信工程、自動(dòng)化、測(cè)控技術(shù)等專(zhuān)業(yè)的教材，也可供相關(guān)研究人員參考閱讀。
	
	
	
   
	
	
	
作者簡(jiǎn)介

	

	
暫缺《集成數(shù)字系統(tǒng)EDA設(shè)計(jì)：硬件描述語(yǔ)言應(yīng)用實(shí)訓(xùn)》作者簡(jiǎn)介
	
	
	
	
	
	
圖書(shū)目錄

	

	
前言
 部分  EDA設(shè)計(jì)基礎(chǔ)
  第1章  集成數(shù)字系統(tǒng)設(shè)計(jì)概述
    1.1  集成數(shù)字系統(tǒng)設(shè)計(jì)方法
    1.2  集成數(shù)字系統(tǒng)設(shè)計(jì)流程
    1.3  集成數(shù)字系統(tǒng)設(shè)計(jì)實(shí)現(xiàn)
    1.4  集成數(shù)字系統(tǒng)設(shè)計(jì)描述
    1.5  集成數(shù)字系統(tǒng)設(shè)計(jì)工具
  第2章  可編程邏輯器件概述
    2.1  可編程邏輯器件分類(lèi)
    2.2  可編程邏輯器件發(fā)展
    2.3  簡(jiǎn)單可編程邏輯器件結(jié)構(gòu)原理
    2.4  復(fù)雜可編程邏輯器件結(jié)構(gòu)原理
    2.5  現(xiàn)場(chǎng)可編程門(mén)陣列結(jié)構(gòu)原理
  第3章  硬件描述語(yǔ)言VHDL基本語(yǔ)法
    3.1  VHDL程序結(jié)構(gòu)
    3.2  VHDL語(yǔ)法要素
    3.3  VHDL并行語(yǔ)句
    3.4  VHDL順序語(yǔ)句
  第4章  硬件描述語(yǔ)言Verilog基本語(yǔ)法
    4.1  Verilog程序結(jié)構(gòu)
    4.2  Verilog語(yǔ)法要素
    4.3  Verilog基本語(yǔ)句
    4.4  Verilog程序數(shù)字電路設(shè)計(jì)方法
  第5章  EDA設(shè)計(jì)開(kāi)發(fā)工具介紹
    5.1  QuartusⅡ 13.0
    5.2  ModelSim 10.4
  第6章  常用功能模塊設(shè)計(jì)描述
    6.1  計(jì)數(shù)器模塊
    6.2  偶數(shù)分頻器模塊
    6.3  奇數(shù)分頻器模塊
    6.4  數(shù)控分頻器模塊
    6.5  BCD-7段譯碼器模塊
    6.6  動(dòng)態(tài)掃描譯碼顯示模塊
    6.7  帶權(quán)表決器模塊
    6.8  串-并轉(zhuǎn)換模塊
    6.9  并-串轉(zhuǎn)換模塊
    6.10  數(shù)字序列產(chǎn)生模塊
    6.11  數(shù)字序列不重疊檢測(cè)模塊
    6.12  數(shù)字序列可重疊檢測(cè)模塊
  第7章  宏功能模塊及其調(diào)用
    7.1  PLL鎖相環(huán)模塊
    7.2  除法器模塊
    7.3  乘法累加模塊
    7.4  雙口RAM模塊
    7.5  只讀ROM模塊
第二部分  EDA實(shí)訓(xùn)案例
  第8章  集成數(shù)字系統(tǒng)實(shí)訓(xùn)1——溫濕度檢測(cè)系統(tǒng)設(shè)計(jì)
    8.1  設(shè)計(jì)任務(wù)及原理說(shuō)明
    8.2  設(shè)計(jì)方案
	
	

	

    
       
    
	
	

   

   

   

    
   

   
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